问题描述：
[单选]
器件调试加载多功能管脚描述正确的是（）
A．A JTAG接口要求tck下拉 其他信号上拉
B．B CPLD通过配置寄存器，FPGA通过外部管脚来配置上电IO状态
C．C PH1系列非JTAG模式下，在initn拉高并且保持5us高电平后，d0-d31才能输入高电平，在这之前需要保持三态或低电平
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